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这里的文章会逐渐与公众号ExASIC同步。由于微信公众号文章的修改限制,一些小的笔误将只在这里修改,请谅解。

IC行业自媒体自律公约的倡议书

一些开源程序(原github)

seq101:'101' sequence detector
tcpiptoy.zip:用verilog实现了UDP协议的收发
uvm_auto.zip:用Mako自动产生UVM的示例
vloglib.zip:verilog的python库
pytoolbox.zip:python脚本
emacs.zip:emacs配置文件
(或者https://github.com/chenfengrugao/emacs
syntastic.zip:gvim调用vcs来检查verilog语法插件
gtimer.zip:linux gtk的时钟
personal_team_blogs.zip:博客
add_bookmark_to_toolbar.zip:firefox插件

提示:带xxx.zip标题的,点击后将直接下载,尽量在PC端操作。

Python在ASIC中的应用

基础篇
为什么选择Python(Perl、Tcl、Python比较)
初识Python语言
写Python程序前的准备:安装
我的第一个Python程序
Python的数据类型(一):介绍
python的数据类型(二):数字
python的数据类型(三):字符串
python的数据类型(四):列表List和元组Tuple
python的数据类型(五):字典Dict
python的条件和循环
python的函数(一):基本概念
python的函数(二):作用域
python的函数(三):参数传递
python的函数(四):递归函数、匿名函数等
pylint警告: Unused variable 'xxx'

中级篇
python的模块module介绍
用模块和包让代码更整洁
python基础模块三剑客:sys、os、shutil
python读写文件
python的正则(一):简单够用的basic版
字符串的编解码(base64)

高级篇
Python的类(一):入门
python中@classmethod与@staticmethod的区别和使用方法
python函数的装饰器(Decoration)

实战篇
通用
自己写个argument parser
python自动输入密码的神器:pexpect
基于pyqt5的对数计算器(带GUI)
通过简易http服务器来远程执行命令
防误删终极解决方案:用mv代替rm,实现回收站
Python常用模块介绍:colorama(为Terminal添加色彩)
算法
用python生成bmp图片
用python读取bmp图片
用python对比bmp图片
用python来处理待打印的深色背景图片
前端设计
用Python检查代码中的TODO、FIXME、XXX
阅读与解析:nvdla epython代码
nvdla epython用于自动生成状态机编码的实例
IC验证
获取系统当前时间,生成SVSEED
自动生成UVM的方法:介绍python的Mako模块
对比文件内容是否相同
multiprocessing在并行仿真中的应用
后端设计
用python实现一个verilog网表Parser

IC验证

通过DPI-C来获得指定目录的文件列表

Linux基础

IC设计中常用的Linux命令
一些必知必会的Linux管理员命令
IC设计中Linux shell的选择和使用(bash、tcsh、zsh)
芯片设计中的Makefile简明教程
GNU sed实例教程
推荐几款Windows上的类Linux小工具
Emacs的安装、配置和使用
Emacs导览(ExASIC翻译)
RTL顶层自动连线的秘武器:Emacs verilog-mode介绍
Emacs如何在当前verilog文件中根据选中的文本快速查找并高亮显示
centos7安装VLC视频播放器

软件与互联网

用php+markdown搭建个人博客
Markdown博客中让图片居中
为博客提供订阅功能
Markdown博客中的段落对齐
我收藏的telegram channel和group
字节跳动的兴趣社交APP“飞聊”的使用感受
使用git hook来自动更新博客

关注EDA上云和AI

EDA Finds a Common Framework for AI
AI Challenges for Next-Gen EDA
开源仿真工具Icarus Verilog的工作原理
开源仿真工具Icarus Verilog中的命令行参数处理方法
开源仿真工具Icarus Verilog中的预处理ivlpp
开源仿真工具Icarus Verilog中的verilog parser
EDA 3.0
一些EDA和IP公司
开源综合工具Yosys中的Verilog Parser
用python实现一个verilog网表Parser

谈谈学习和就业

数字IC设计工程师要具备哪些技能
应届生如何备战DV岗位的面试
FPGA工程师如何转行做ASIC
从幕后到台前,开启职场新思路
职业生涯规划中应该思考的几个问题
如何在技术面试中脱颖而出
非技术面试到底在面些什么

IC English

how do you write bussiness emails and weekly reports
how to run an effective meeting
How to introduce a project in a meeting
how to read JD and write CV

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